Modo asíncrono (transmisión)
Siempre que la CPU envía un carácter de dato, el C.I. 8251 le agrega automáticamente a este dato un bit de arranque (START, de nivel bajo) y un número programado de bits de parada (STOP). También, un bit de paridad par o impar se inserta antes del bit de parada, según se defina en la instrucción de modo. El carácter es entonces transmitido como un flujo de datos serie en la salida TxD. El dato serie se recorre con el borde de bajada de TxC a una razón igual a 1, 1/16, ó 1/64 de aquella de TxC, como se ha definido por la instrucción de modo.
Fuente: Apuntes de Arquitectura de computadoras de la FCA de la UNAM